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基于FPGA的數(shù)字射頻存儲器設(shè)計

發(fā)布時間:2021-01-12 05:36
  數(shù)字射頻存儲器(Digital Radio Frequency Memory DRFM)具有對射頻信號和微波信號的存儲、處理及傳輸能力,已成為現(xiàn)代雷達(dá)系統(tǒng)的重要部件,F(xiàn)代雷達(dá)普遍采用了諸如脈沖壓縮、相位編碼等更為復(fù)雜的信號處理技術(shù),DRFM由于具有處理這些相參波形的能力,被越來越廣泛地應(yīng)用于電子對抗領(lǐng)域作為射頻頻率源。目前,國內(nèi)外對DRFM技術(shù)的研究還處于起步階段,DRFM部件在采樣率、采樣精度及存儲容量等方面,還不能滿足現(xiàn)代雷達(dá)信號處理的要求。本文介紹了DRFM的量化類型、基本組成及其工作原理,在現(xiàn)有的研究基礎(chǔ)上提出了一種便于工程實現(xiàn)的設(shè)計方法,給出了基于現(xiàn)場可編程門陣列(Field Programmable Gate Array FPGA)實現(xiàn)的幅度量化DRFM設(shè)計方案。本方案的采樣率為1 GHz、采樣精度12位,具體實現(xiàn)是采用4個采樣率為250 MHz的ADC并行交替等效時間采樣以達(dá)到1 GHz的采樣率。單通道內(nèi)采用數(shù)字正交采樣技術(shù)進(jìn)行相干檢波,用于保存信號復(fù)包絡(luò)的所有信息。利用FPGA器件實現(xiàn)DRFM的控制器和多路采樣數(shù)據(jù)緩沖器,采用硬件描述語言(Very High Speed... 

【文章來源】:燕山大學(xué)河北省

【文章頁數(shù)】:75 頁

【學(xué)位級別】:碩士

【部分圖文】:

基于FPGA的數(shù)字射頻存儲器設(shè)計


異步FIFO的參數(shù)

讀寫時序,核設(shè)計,時序仿真,參數(shù)


圖 3-10 異步 FIFO 的參數(shù)Fig. 3-10 The index of asynchronous FIFO利用 IP 核設(shè)計的異步 FIFO 時序仿真圖如圖 3-11 所示。

格雷碼編碼,仿真結(jié)果,格雷碼


Rd_next_gray(1)<=read_addr(2) xor read_addr(1);Rd_next_gray(0)<=read_addr(1) xor read_addr(0);end if;end if;end process proc4;讀地址格雷碼的仿真圖如圖 3-13 所示。同理可以得到寫地址格雷碼編。采用觸發(fā)器來同步異步輸入信號,這種方法可以將出現(xiàn)亞穩(wěn)態(tài)的幾率到一個很小的程度,但是,這種方法同時對輸入信號帶來了一級延時,在設(shè)計時加以注意。

【參考文獻(xiàn)】:
期刊論文
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碩士論文
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[3]欠采樣DRFM技術(shù)研究[D]. 張潔.西安電子科技大學(xué) 2005
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[6]高精度數(shù)字正交采樣/插值方法及其應(yīng)用研究[D]. 劉芬.燕山大學(xué) 2004
[7]1GHz數(shù)字射頻存儲器的設(shè)計[D]. 王振峰.南京航空航天大學(xué) 2002



本文編號:2972259

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