發(fā)布時間：2020-12-10 23:47

　　隨著計算機軟硬件技術(shù)的不斷進步,高性能計算領(lǐng)域迅猛發(fā)展;高性能計算領(lǐng)域的迅猛發(fā)展同時又對高性能微處理器不斷提出新的需求。實現(xiàn)未來的超高性能計算機,硬件技術(shù)、體系結(jié)構(gòu)、編程模型、算法、應(yīng)用、工具等多個環(huán)節(jié)都面臨著來自性能、功耗、可靠性等多個因素的挑戰(zhàn)。處理器核的體系結(jié)構(gòu)直接決定了處理器的性能、功耗、可靠性等特性,并且對系統(tǒng)編程模型、算法及應(yīng)用都有顯著的影響。本文針對未來高性能計算所面臨的性能、功耗、可靠性等挑戰(zhàn),研究并提出一種高效能處理器核體系結(jié)構(gòu)CAMPER（Core Architecture with Multi-thread,Power-Efficiency and Reliability）。CAMPER核基于一種精簡的EPIC（Explicit Parallel Instruction Computing）處理器體系結(jié)構(gòu)設(shè)計,并擴展多線程和向量技術(shù),利用先進的低功耗設(shè)計和高可靠性技術(shù),在原型樣片TENT中實現(xiàn)。本文的主要貢獻和創(chuàng)新點有:1.設(shè)計了一種精簡的EPIC體系結(jié)構(gòu),作為CAMPER的基準結(jié)構(gòu)。提出了一種順序發(fā)射、順序執(zhí)行、順序提交、亂序完成的鎖步執(zhí)行模型（In-order... 

【文章來源】：國防科技大學(xué)湖南省 211工程院校 985工程院校

【文章頁數(shù)】：129 頁

【學(xué)位級別】：博士

【部分圖文】：

超標量發(fā)射寬度與IPC和硬件復(fù)雜度的關(guān)系

1. 2 論文組織結(jié)構(gòu)研究背景和研究思構(gòu)。效能流水線技術(shù)、設(shè)計技術(shù)的相關(guān)研精簡核設(shè)計。介紹結(jié)構(gòu)的設(shè)計，以及量擴展技術(shù)。介紹所做的向量指令集其進行了性能分析術(shù)。介紹了體系結(jié)對低功耗設(shè)計效果術(shù)。介紹了 CAM錯執(zhí)行模型。了以 CAMPER 核構(gòu)

已經(jīng)從指令級并行性開發(fā)轉(zhuǎn)到任務(wù)的限制導(dǎo)致無法使用更加激進的指數(shù)據(jù)中心等應(yīng)用領(lǐng)域，系統(tǒng)運營的主外，功耗的增加會使處理器的可靠理器的發(fā)展已不再單純的追求性能[20]。用處理器中，高效能流水線設(shè)計的25]和 Intel 公司的 ITANIUM2 處理器。器流水線結(jié)構(gòu) 公司 2007 年發(fā)布的一款高效能理器核，每個核支持 2 個硬件線程，B 私有一級數(shù)據(jù) Cache 和 4MB 私有示。

【參考文獻】：
期刊論文
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博士論文
[1]納米集成電路軟錯誤分析與緩解技術(shù)研究[D]. 孫巖.國防科學(xué)技術(shù)大學(xué) 2010
[2]多核微處理器容軟錯誤設(shè)計關(guān)鍵技術(shù)研究[D]. 龔銳.國防科學(xué)技術(shù)大學(xué) 2008
[3]超深亞微米微處理器漏流功耗的體系結(jié)構(gòu)級優(yōu)化技術(shù)研究[D]. 張承義.國防科學(xué)技術(shù)大學(xué) 2006
[4]面向動態(tài)二進制翻譯的動態(tài)優(yōu)化和微處理器體系結(jié)構(gòu)支撐技術(shù)研究[D]. 唐遇星.國防科學(xué)技術(shù)大學(xué) 2005

碩士論文
[1]EPIC體系結(jié)構(gòu)研究與流水線設(shè)計及實現(xiàn)[D]. 高軍.中國人民解放軍國防科學(xué)技術(shù)大學(xué) 2002



本文編號：2909504