基于GPU的SDN網(wǎng)絡(luò)并行業(yè)務(wù)量工程算法研究
【學(xué)位單位】:電子科技大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位年份】:2018
【中圖分類】:TP393.0
【文章目錄】:
摘要
abstract
第一章 緒論
1.1 研究背景與意義
1.2 國(guó)內(nèi)外研究現(xiàn)狀
1.2.1 SDNIP網(wǎng)絡(luò)下業(yè)務(wù)量工程算法的研究現(xiàn)狀
1.2.2 SDN彈性光網(wǎng)絡(luò)下業(yè)務(wù)量工程算法的研究現(xiàn)狀
1.3 論文內(nèi)容及結(jié)構(gòu)安排
第二章 GPU硬件結(jié)構(gòu)與CUDA編程模式
2.1 CPU與GPU
2.1.1 CPU與GPU區(qū)別
2.1.2 CPU+GPU異構(gòu)計(jì)算模型
2.2 GPU硬件架構(gòu)
2.2.1 流處理器
2.2.2 線程束(Warp)
2.2.3 存儲(chǔ)結(jié)構(gòu)
2.2.4 流多處理器細(xì)節(jié)
2.2.5 執(zhí)行模型
2.3 CUDA編程模式
2.3.1 CUDA軟件線程組織
2.3.2 kernel函數(shù)
2.3.3 CUDA線程同步
2.3.4 CUDA流并行
2.4 本章總結(jié)
第三章 SDNIP網(wǎng)絡(luò)下的并行業(yè)務(wù)量工程算法研究
3.1 引言
3.2 網(wǎng)絡(luò)模型和問題建模
3.2.1 網(wǎng)絡(luò)模型
3.2.2 問題建模
3.3 基于遺傳算法的業(yè)務(wù)量工程算法
3.3.1 備選路模型
3.3.2 遺傳算法設(shè)計(jì)
3.3.2.1 染色體結(jié)構(gòu)
3.3.2.2 初始可行解的生成
3.3.2.3 評(píng)價(jià)與排序
3.3.2.4 交叉
3.3.2.5 變異
3.3.2.6 終止條件
3.3.3 基于GPU的并行遺傳算法設(shè)計(jì)
3.3.3.1 并行評(píng)價(jià)算法設(shè)計(jì)
3.3.3.2 并行排序,變異與交叉
3.4 基于拉格朗日的優(yōu)化算法設(shè)計(jì)
3.4.1 基于拉格朗日松弛的模型
3.4.2 基于GPU的并行路由計(jì)算
3.4.3 鏈路權(quán)重更新
3.4.3.1 權(quán)重更新步長(zhǎng)
3.4.3.2 隨機(jī)更新策略
3.4.4 路徑調(diào)整
3.4.5 終止條件
3.5 仿真實(shí)驗(yàn)分析
3.5.1 仿真介紹
3.5.2 目標(biāo)函數(shù)比較
3.5.3 算法時(shí)間比較
3.5.4 算法收斂性
3.6 本章總結(jié)
第四章 SDN彈性光網(wǎng)絡(luò)下的并行業(yè)務(wù)量工程算法研究
4.1 引言
4.2 分層圖模型
4.3 分層圖模型下的業(yè)務(wù)量工程算法
4.4 無權(quán)圖情況下的GPU算法設(shè)計(jì)
4.4.1 相同速率業(yè)務(wù)的并行
4.4.2 不同速率間業(yè)務(wù)的并行
4.4.3 GPU上的kernel設(shè)計(jì)
4.5 帶權(quán)圖情況下的GPU算法設(shè)計(jì)
4.5.1 帶跳數(shù)限制的最短路算法
4.5.2 相同速率業(yè)務(wù)的動(dòng)態(tài)規(guī)劃算法并行
4.5.3 不同速率間業(yè)務(wù)的并行
4.5.4 GPU上的kernel設(shè)計(jì)
4.6 實(shí)驗(yàn)仿真分析
4.6.1 對(duì)比算法
4.6.2 實(shí)驗(yàn)設(shè)置
4.6.3 無權(quán)圖下的仿真結(jié)果
4.6.3.1 路由跳數(shù)優(yōu)化結(jié)果分析
4.6.3.2 時(shí)間分析
4.6.3.3 阻塞率分析
4.6.4 帶權(quán)圖下的仿真結(jié)果
4.6.4.1 路由代價(jià)優(yōu)化結(jié)果分析
4.6.4.2 時(shí)間分析
4.7 本章總結(jié)
第五章 全文總結(jié)與展望
5.1 全文總結(jié)
5.2 后續(xù)工作展望
致謝
參考文獻(xiàn)
攻讀碩士學(xué)位期間取得的成果
【相似文獻(xiàn)】
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本文編號(hào):2890237
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